华大九天拟以不超过2.2亿元收购奇捷科技51%股权
华大九天公告拟出资不超过2.2亿元收购参股公司奇捷科技不超过51%的股权,交易完成后奇捷科技将成为其控股子公司并纳入合并报表。拟签协议约定受让50.3762%股权,转让对价21,883.42万元,分期支付,股权转让协议截至公告日尚未签署。
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华大九天公告拟出资不超过2.2亿元收购参股公司奇捷科技不超过51%的股权,交易完成后奇捷科技将成为其控股子公司并纳入合并报表。拟签协议约定受让50.3762%股权,转让对价21,883.42万元,分期支付,股权转让协议截至公告日尚未签署。
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Circuit Mind 发布 AVE(Agentic Verification Engine),用于自动审查电路原理图,可检查 ACE 生成的设计,也可检查用常规 ECAD 工具手工绘制的原理图。
Chipmind 演示了其生成式 UI 产品 RTL Canvas:工程师在现有芯片架构图上画红叉删除模块,AI 智能体 Chipmind John 解析意图、更新 RTL 实现,并以可交互的可视化 diff 返回结果供审批。该演示仅覆盖一个简单示例,Chipmind 称 RTL Canvas 旨在让团队以架构而非文本提示的方式设计、探索和评审大规模芯片与复杂 SoC,更多能力仍在开发中。

Chipmind 发布 RTL Canvas,称其为芯片设计工程师与 AI 智能体之间的首个双向契约界面,工程师可在 RTL 图上直接绘制架构意图,智能体生成的改动以可视化差异回显。
Chipmind 称其芯片设计智能体 John 在 20 分钟内把 SHA 加密核集成进一颗 SoC,改动 15 个文件且 CI 测试通过,全程无人工交互。John 在既有设计环境中调用 EDA 工具,完成 OBI 到 AXI 桥接、扩展 RTL 测试平台与固件测试并跑通仿真,最终由人类工程师评审通过。

Chipmind CEO Harald Kröll 在达沃斯 AI House 参加“GenAI is More Than LLMs”专题讨论,介绍 AI 芯片设计如何跨越通用大模型与开发流程之间的“空白地带”。他指出,通用模型能力虽广,但半导体行业的真正加速来自将 AI 原生融入复杂的 EDA 与开发环境,构建面向硬件工作流的设计感知系统。
Chipmind 官方阐述其 AI 设计助手将 IP-XACT(IEEE 1685)、SystemRDL 等标准化元数据作为一等输入输出,并同步生成寄存器映射、文档与固件头文件。