Si2 发布年度报告亮点：LBC-bench 榜单、OpenAccess 参考实现与紧凑模型发布
Si2 在 DAC 年度会员大会上公布年度亮点，包括 LLM Benchmarking Coalition 发布带 CVDP 基准结果的 LBC-bench 榜单，OpenAccess Coalition 宣布 4 个 OA 参考实现和 3 个 OA 扩展版本。
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#标准/互操作
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Silicon Integration InitiativeAI 评分4040
Accellera Systems Initiative精选AI 评分6060 Accellera 批准功能安全语言标准 FSL 1.0 发布
Accellera 董事会批准功能安全语言标准 FSL 1.0 发布，该标准为功能安全信息的表示、交换和集成提供统一语言与数据模型，可立即下载。FSL 1.0 基于 TCL 语法，支持跨供应链创建和交换 FMEDA 数据，涵盖失效模式、安全机制、技术信息与安全需求，并支持分层 FMEDA 及 ISO 26262、IEC 61508 相关失效率与指标的计算报告。
推荐理由：FSL 1.0 把功能安全数据从表格和私有格式中抽出来，可用于观察安全分析与设计验证流程的衔接方式。
Accellera Systems InitiativeAI 评分5858 Accellera 批准功能安全语言标准 FSL LRM 1.0 发布
Accellera 批准功能安全语言标准 FSL LRM 1.0 发布，该标准提供数据模型驱动的语言，用于编写和交换 FMEDA 数据，包括失效模式、安全机制和安全指标。Agnisys、Intel、Siemens EDA 和 Synopsys 在引述中表示支持，并称该标准有助于弥合 ISO 26262 与 IEC 61508 要求同数据采集共享方式之间的差距，提升半导体供应链的互操作性与可追溯性。
UCIe ConsortiumAI 评分1818 
UCIe 3.0 在 FMS 2026 引发关注，入围 Best in Show 连接类决赛
UCIe 联盟在 FMS 2026 上介绍了 UCIe 3.0 规范，其赞助专场由 Intel 的 Gerald Pasdast 主讲，梳理 UCIe 三代演进并说明 3.0 如何推进开放标准化的 die-to-die 互连。
UCIe ConsortiumAI 评分2222 
UCIe 联盟：以开放 Chiplet 生态支持汽车计算未来
UCIe 联盟通过标准化 die-to-die 互连推进面向汽车计算的开放 Chiplet 生态，其汽车工作组（AWG）负责把汽车需求转化为对 UCIe 演进的输入，而不重新定义规范或给出完整系统级方案。
Sigasi 官方动态AI 评分2222 Sigasi 产品管理副总裁 Lieven Lemiengre 出任 IEEE VHDL 工作组主席
Sigasi 产品管理副总裁 Lieven Lemiengre 被任命为 IEEE P1076 VHDL 分析与标准化组主席，该工作组负责 VHDL 的持续开发与标准化。
Silicon Integration InitiativeAI 评分5858 Si2 AI/ML 工作组公开发布面向 EDA 的 AI 本体
Si2 AI/ML Schema/Ontology 工作组公开发布其 AI for EDA Ontology，以 Apache 2.0 许可在 GitHub 开源，目标是提供示例本体与用例，支持 EDA 智能体系统实验。
UCIe ConsortiumAI 评分2222 
UCIe联盟成员访谈：Socionext谈其UCIe贡献与路线图
Socionext以Contributor成员身份参与UCIe联盟，正评估基于UCIe的裸片间互连技术并计划将其集成到面向数据中心与汽车市场的定制SoC平台。公司计划在物理层、可测试性标准和集成方法论方面贡献力量，并与封装伙伴评估2.5D/3D/5.5D集成方案。其看好的应用包括数据中心AI/ML加速器集成、软件定义汽车的异构计算平台及高分辨率成像系统。
UCIe ConsortiumAI 评分5555 
Chiplet Summit 2026：UCIe 3.0 获互操作奖项，Intel 与 Cadence 演示跨厂商互操作
UCIe Consortium 在 Chiplet Summit 2026 上宣布，UCIe 3.0 规范获得大会连接与互操作性最佳展示奖，该规范将数据率提升至 48 GT/s 和 64 GT/s，并增强功耗优化与可管理性。
Accellera Systems Initiative精选AI 评分7373 Accellera 发布 CDC/RDC 标准 1.0，多家 EDA 与芯片厂商表态支持
Accellera 发布《Standard for IP Abstraction for Clock and Reset Domain Crossing Integration》LRM 1.0，多家厂商发表声明祝贺。
推荐理由：多家 EDA 与芯片厂商就 CDC/RDC 标准 1.0 表态，可看出该标准在 IP 抽象与跨工具验证上的协作范围。
Accellera Systems Initiative精选AI 评分7070 Accellera 批准时钟与复位域交叉（CDC/RDC）标准 1.0 发布
Accellera 董事会批准《IP 抽象时钟与复位域交叉集成标准 1.0》并开放下载，该标准定义厂商中立的 CDC/RDC 意图描述方式，使 IP 提供方与 SoC 集成方能在不同 EDA 工具间交换分析结果并完成签核。
推荐理由：该标准针对不同工具间 CDC/RDC 分析结果无法复用的问题，定义了厂商中立的意图交换方式，可用于评估 IP 到 SoC 集成流程的接入条件。
UCIe ConsortiumAI 评分2222 
UCIe 联盟在 Chiplet Summit 2026 上推广开放 Chiplet 生态
UCIe 联盟将参加 2 月 17-19 日在圣克拉拉会议中心举办的 Chiplet Summit，并扩大参与规模，赞助多场活动。联盟主席 Debendra Das Sharma 将发表主题演讲，介绍 UCIe 3.0 规范及裸片间互连标准的采用收益；Intel 与 Cadence 成员将分享互操作性案例。
UCIe ConsortiumAI 评分3030 
UCIe Consortium 2025 年度回顾：UCIe 3.0 规范与生态进展
UCIe Consortium 回顾 2025 年进展，核心是 UCIe 3.0 规范支持 48 GT/s 和 64 GT/s 数据传输速率，并带来架构更新以提升带宽密度、能效与系统级可管理性。