Sigasi 将携确定性 HDL 平台参加印度 BSX 与 ESA 产业日
Sigasi 将于今年 9 月携确定性 HDL 平台参加两场航天业活动：9 月 7–9 日与印度分销商 Muspark 一同出席班加罗尔航天博览会（BSX），9 月 16–17 日参加荷兰 ESA/ESTEC 的欧洲产业航天日。Sigasi Visual HDL 面向长生命周期 FPGA 与 ASIC 开发及混合语言代码库，强调在设计早期发现语义问题。
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Sigasi 官方动态AI 评分1212 CHIPS AllianceAI 评分3838 
CHIPS Alliance 开源 I3C Core 新增 Host Controller 支持
CHIPS Alliance 成员 Antmicro 为开源 I3C Core 实现了 Host Controller 支持，此前该核仅支持 Target 模式。
Chipmind 官方动态AI 评分2222 Chipmind 演示 RTL Canvas：面向芯片设计的生成式 UI
Chipmind 演示了其生成式 UI 产品 RTL Canvas：工程师在现有芯片架构图上画红叉删除模块，AI 智能体 Chipmind John 解析意图、更新 RTL 实现，并以可交互的可视化 diff 返回结果供审批。该演示仅覆盖一个简单示例，Chipmind 称 RTL Canvas 旨在让团队以架构而非文本提示的方式设计、探索和评审大规模芯片与复杂 SoC，更多能力仍在开发中。
Sigasi 官方动态AI 评分2222 Sigasi 产品管理副总裁 Lieven Lemiengre 出任 IEEE VHDL 工作组主席
Sigasi 产品管理副总裁 Lieven Lemiengre 被任命为 IEEE P1076 VHDL 分析与标准化组主席，该工作组负责 VHDL 的持续开发与标准化。
ChipNexus 官方动态精选AI 评分6262 ChipNexus 发布 NEX v5.61，改进仓库导航与 EDA 工具结果呈现
ChipNexus 发布 NEX v5.61，新增仓库级 grep 和 glob 工具，让智能体在遵循嵌套 .gitignore 规则的前提下检索大型代码库，并优先处理近期修改的文件。
推荐理由：原文列出仓库级检索、EDA 工具结果结构化与缓存改进，可用于比较智能体接入现有 RTL 与验证流程的条件。
Silicon Integration InitiativeAI 评分2020 Si2 公布年度 Power of Partnerships 奖，LLM Benchmarking Coalition 领导团队获奖
Si2 将 2026 年度 Power of Partnerships 奖授予 LLM Benchmarking Coalition 领导团队，表彰其推动面向 EDA 与芯片设计的 LLM 及智能体流程基准套件与排行榜。该团队还招募企业及高校成员，并通过 LBC 研讨会和行业会议推广参与。团队成员来自 NVIDIA、纽约大学、Synopsys 和 IBM。
ChipAgents 官方技术博客AI 评分3636 
ChipAgents 谈多智能体编排：通往 IC 设计自主化的路径
ChipAgents 提出以多智能体编排替代单点 AI 智能体，让多个专用智能体在隔离沙箱中并行探索假设、调用 EDA 工具并评估结果，由工程师在关键节点审核。其平台在客户 WhaleChip 的部署中把 3D IC 根因分析从数天缩短到 15 分钟。文章以功耗优化流程为例，说明单点加速无法压缩整体串行循环，编排才能压缩整个设计迭代。
概伦电子AI 评分4242 概伦电子战略投资启芯领航，深化EDA+IP全链协同
概伦电子宣布完成对启芯领航的战略投资，双方将打通芯片设计、硬件验证与高速接口IP关键环节。此次投资重点补齐数字前端验证能力，与启芯领航的数字验证工具和高速接口IP联动概伦电子的器件建模、电路仿真能力，形成“仿真验证+工艺实现”闭环。此前概伦电子已与鸿芯微纳合作数字后端物理实现，本次布局进一步完善其EDA+IP双核心底座。
培风图南AI 评分2222 
第九届创芯大赛培风图南命题：从极限到规则的DTCO探索
8月16日，“华为杯”第九届中国研究生创“芯”大赛全国总决赛在深圳南方科技大学落幕，培风图南企业命题《基于规则垂直纳米线阵列的高密度逻辑电路设计与DTCO协同优化》聚焦将存储器垂直阵列结构迁移至逻辑电路，在保证逻辑功能前提下提升晶体管与逻辑门密度。参赛队伍使用Mozz TCAD软件套件完成仿真评估与模型抽取，四支队伍获该命题一个一等奖和三个二等奖。
广立微AI 评分5555 
广立微QuanTest-YAD通过头部Fab认证并在多家Fabless商用
广立微宣布QuanTest-YAD良率感知大数据诊断分析平台已通过行业头部Fab功能与性能双重认证，并在多家顶级Fabless商用落地。该平台打通DFT诊断数据与YMS良率管理系统，融合AI算法实现数据解析、根因定位与PFA候选点推荐的全流程自动化分析。
CHIPS Alliance Chisel 发行AI 评分4242 Chisel v7.14.0 发布：弃用隐式截断，新增显式截断连接运算符
Chisel v7.14.0 发布，正式弃用隐式截断，配套 firtool 1.155.0 会对隐式截断值打印警告且无法在 firtool 中抑制。新增 `:%=` 显式截断连接运算符，`.squeeze` 改为发出显式截断而非隐式宽度强制转换。核心还加入 domain.domainOf、domain.Mux、LTL always 运算符及 Connectable 对 Option 的支持。
ChipAgents 官方技术博客AI 评分5050 
ChipAgents 如何用 AI 智能体加速时序收敛
ChipAgents 介绍其构建 AI 智能体闭环以加速时序收敛的方法：在 RTL 阶段为智能体提供分钟级的快速 PPA 反馈，使其能比较不同方案、剔除导致功耗或面积不可接受回退的时序修复。
ACM SIGDAAI 评分1818 
CADathlon Brasil 2026 集成电路设计自动化编程竞赛结果揭晓
CADathlon Brasil 2026 于 7 月 23 日在巴西 Gramado 举行，与第 46 届 SBC 年会同期，共 19 支队伍参赛创下纪录。UFSC 的“Electronic Design Arts”队（Lucas Tinoco、Felipe Savi）获第一名，UnB 的“Brasil Venceu?
YosysHQ nextpnr 布局布线发行AI 评分1818 nextpnr 0.11.1 发布，修复 WASM 构建问题
YosysHQ 发布 nextpnr 0.11.1，这是针对 0.11 版本的补丁更新，修复了此前损坏的 WASM 构建。
CHIPS AllianceAI 评分2222 
DAC 2026 开源 EDA BoF 聚焦 AI 辅助与开源硬件生态
DAC 2026 第七届开源 EDA Birds-of-a-Feather 会议吸引超过 120 名参会者，讨论 AI、开源硬件与开源 EDA 的交叉。OpenROAD 介绍了组织与治理结构更新，CHIPS Alliance 汇报了开源硬件与 EDA 项目协作进展，会上还宣布 2nm nanosheet 研究 PDK 可用并更新 3D ODB。
FOSSi FoundationAI 评分2222 
FOSSi Foundation《El Correo Libre》第99期：ORConf 2026征稿将截止、KianV RISC-V芯片硅上启动Linux
FOSSi Foundation《El Correo Libre》第99期汇总开源硅生态动态：ORConf 2026征稿将于8月16日截止，会议9月11日至13日在比利时根特与FPL 2026同期举行。
芯华章AI 评分2222 IC Agent 会写会跑会改，工程师还怎么长本事？
芯华章转载文章讨论 IC Agent 演示读 spec、生成 RTL 与 testbench、读 log 给 patch 并整理报告后，工程师如何继续成长。作者认为 Agent 最危险之处在于提前替人处理掉失败、反馈与打回，而判断对错、风险、证据和边界的能力才是可迁移的护城河。
Agnisys 官方动态AI 评分4040 
Agnisys 推出 IDS-NoC：面向现代 SoC 的可配置 NoC IP 生成器
Agnisys 推出 IDS-NoC 可配置生成器，可按用户定义配置自动生成 NoC IP，支持拓扑、路由算法、仲裁策略及 initiator/target 数量等参数。生成的 NoC 采用 mesh 拓扑，通过 Network Interface 将 AXI4 事务打包为 72 位定宽 flit 传输，并按写地址/写数据、写响应、读地址、读数据划分四条虚拟通道以降低死锁风险。
奇捷科技AI 评分1818 
奇捷科技入选“科创中国”AI软件赛道TOP10
奇捷科技入选“科创中国”创新创业投资大会“AI软件”赛道TOP10榜单。本届大会共征集641个创新项目，经多轮评审后49个项目脱颖而出，奇捷科技凭借EDA领域技术积累从全国600余个硬核科技项目中入选。
YosysHQ nextpnr 布局布线发行AI 评分4848 YosysHQ nextpnr 0.11 "Gartnerwand" 布局布线发行
YosysHQ 发布开源布局布线工具 nextpnr 0.11，代号 "Gartnerwand"，并宣布此后所有版本均采用山峰命名。静态布局器在鲁棒性与 QoR 上改进并支持更多架构；堆布局器新增控制集感知合法化 API，目前用于加速 Xilinx 布局。
Silicon Integration InitiativeAI 评分1212 Si2 欢迎 Normal Computing 的 Thomas Ahle 加入董事会
Si2 宣布 Normal Computing 机器学习负责人 Thomas Ahle 当选 2026-2027 年度董事会成员。Ahle 曾任 Meta 概率部门机器学习效率组技术负责人，并联合创办对话式 AI 初创公司 SupWiz，此前在 Palantir 参与企业 AI 平台 Palantir Foundry。
Silicon Integration InitiativeAI 评分1818 
Si2 公布 2026-2027 年度董事会选举结果
Si2 完成 2026-2027 年度董事会选举，2025-2026 届董事会 13 名成员连任，并新增一名董事。新当选董事为 Normal Computing 机器学习负责人 Thomas Ahle，其此前曾在 Meta 领导机器学习效率团队，并联合创办对话式 AI 初创公司 SupWiz。
Silicon Integration InitiativeAI 评分2020 IBM 的 Leon Stok 连任 Si2 董事会主席
IBM 电子设计自动化副总裁 Leon Stok 连任 Silicon Integration Initiative 2026-2027 年度董事会主席，他自 2007 年起担任 Si2 董事，此前已数次出任该职。
OSVVM 官方验证方法新闻AI 评分3838 
用 rv32 与 OSVVM 协同仿真联合调试 RISC-V 代码与逻辑
在 OSVVM 协同仿真环境中，rv32 RISC-V 指令集仿真器（ISS）内置的 gdbserver 代码可让 GDB 通过 TCP/IP socket 以远程目标方式连接，从而在逻辑仿真器之外同时调试 RISC-V 应用代码。
芯行纪AI 评分88 
芯行纪邀您相约IDAS 2026
芯行纪将出席9月1日至2日在上海张江举行的第四届设计自动化产业峰会（IDAS 2026），并携数字实现EDA领域的前沿实践成果与产业洞察参会。公司称其将机器学习与分布式计算技术应用于数字实现EDA自主研发与工程落地，届时将与产业伙伴围绕差异化产品竞争力、芯片设计智能提效与流程进化展开交流。
思尔芯AI 评分5858 
思尔芯发布 RCF RTL 自动分割工具，面向大规模 AI/HPC 芯片原型验证
思尔芯推出自研综合器与 RCF（RTL Compile Flow）工具，直接在 RTL 代码层面做全局时序驱动的自动分割，并让综合与布局布线并行处理，以缩短编译周期、保持设计结构和信号名称一致。
思尔芯AI 评分3838 
面向超大规模SoC的硬件辅助验证：技术演进与左移策略实践
思尔芯阐述面向超大规模SoC的硬件辅助验证（HAV）技术演进与左移策略：硬件仿真运行速度约1MHz、具备全波形追踪与断点调试能力，FPGA原型验证可达十至上百MHz，二者正从割裂走向统一平台。统一架构需应对自动化多FPGA分割、时钟域映射与混合协同验证（连接SystemC或QEMU）等挑战。左移流程分四阶段：RTL早期硬件仿真调试、早期软件开发与软硬件协同、合规性认证、硅前客户对接验证。
思尔芯AI 评分1212 
思尔芯携手南京大学共育新工科人才，校企协同打造暑期实战课堂
思尔芯作为合作企业出席南京大学集成电路学院暑期学校开学典礼暨暑期校企协同课程群启动仪式，总裁林铠鹏致辞。本次暑期学校开设11门校企协同课程，涵盖设计、封测、制造、光电及国际化合作五大方向，集中在2～4周内以“理论授课+实验实践交叉”模式完成。思尔芯在协同课程中加入AI辅助验证模块，引导学生探索“懂电路”与“擅用AI”结合的EDA新范式。
思尔芯AI 评分4242 
思尔芯以数字前端EDA全流程方案推动芯片设计左移与RISC-V生态落地
思尔芯以“聚力生态、左移周期、提前闭环”为核心战略，构建覆盖芯神匠架构设计、芯神驰软件仿真、芯神鼎硬件仿真、芯神瞳原型验证、芯神觉数字调试及EDA云平台的数字前端全流程方案。
Siemens Calibre 官方技术博客AI 评分5858 
Siemens 推出 Calibre Vision AI，将数十亿 DRC 违例归并为可处理信号
Siemens 在 Calibre 官方博客介绍 Calibre Vision AI，用于先进节点 DRC 调试，把数十亿条违例压缩为数百个可处理的 Signal。
YosysHQ Yosys 综合发行AI 评分3030 Yosys 0.68 发布
Yosys 0.68 发布，新增 symfpu 与 symfpu_convert 两个 pass。该版本移除了 abc pass 的 -fast 选项、flowmap pass 及 synth 和 synth_ice40 中的 -flowmap，并移除 read_aiger 的 -wideports 选项；同时修复 nexus 的 Radiant 网表兼容性。
YosysHQ 官方动态AI 评分1818 
YosysHQ 发布 Tabby CAD Suite 20260805 版本
YosysHQ 发布 Tabby CAD Suite 20260805 版本，该版本包含底层性能改进与缺陷修复。同月消息中，欧洲芯片开放设计环境（ODE4EC）正式启动，YosysHQ 为该计划参与方；其 CTO Claire 将在 FMCAD 2026 发表主题演讲。
奇捷科技AI 评分2020 
奇捷科技携 EasyAI ECO Suite 亮相 DAC 2026
奇捷科技在 DAC 2026 展示最新技术成果 EasyAI ECO Suite，将 AI 引擎融入 ECO 全流程，贯穿 SYN NETLIST ECO、DFT NETLIST ECO 与 PR NETLIST ECO 各阶段，以三大核心智能引擎针对补丁大小、运行速度与时序精度瓶颈。
CHIPS AllianceAI 评分3030 
CHIPS Alliance 开发者聚焦：Mehdi Saligane 谈 AI 时代重构芯片设计
CHIPS Alliance 开发者聚焦介绍 Mehdi Saligane 的研究：将 AI 辅助设计、开源 EDA、模拟与混合信号自动化、面向 AI 的软硬件协同设计及可信硬件结合，目标是让定制芯片更自动化、可复现、更易获取。
KLayoutAI 评分2020 
KLayout 0.30.10 发布 macOS DMG 安装包
KLayout 0.30.10 的 macOS DMG 安装包已发布，Python 版本迁移至 3.14（仅限 MacPorts 与 Homebrew），并为下一代 macOS 27 Golden Gate 做准备。
NVC VHDL编译器发行AI 评分1818 NVC VHDL 编译器 1.22.1 发布，修复波形转储与覆盖率问题
NVC VHDL 编译器发布 1.22.1 小版本错误修复更新，波形转储现可输出多个顶层单元而非仅首个精化单元。该版本修复了 `--per-file` 报告中同一实体两个实例泛型值不同时的语句覆盖率错误（#1567），以及记录中非约束字段选中名使用 `vhpi_put_value` 导致的崩溃回归（#1624）。
Sigasi 官方动态AI 评分5858 Sigasi 演示四个智能体工作流：用 MCP 校验 AI 生成的 HDL
Sigasi 发布四个演示，展示 Claude Code、Cursor、Copilot 等编码智能体通过 MCP 和 Sigasi CLI 调用其确定性 HDL 分析，用于迭代生成 SDRAM 控制器、修复项目依赖、排查 UVM 测试平台问题和统一格式化 VHDL、Verilog、SystemVerilog 文件。
OSVVM 官方验证方法新闻AI 评分3838 
如何调试 OSVVM 协同仿真程序
OSVVM 自 2023.01 版本起支持协同仿真，可将 C/C++ 代码编译为宿主机程序并与逻辑仿真通过 API 交互。文章介绍用 GDB 调试这类协同仿真代码：GHDL 直接调试其生成的可执行文件并加载 VUser.so 符号，NVC 则调试 nvc 可执行文件并从批处理日志复制命令行参数。建立 GDB 连接后可接入 Eclipse 等 IDE，实现软件与逻辑在同一验证环境中的双重调试。
ChipAgents 官方新闻室精选AI 评分6262 
ChipAgents 追加 6000 万美元 A2 轮，A 轮总额扩至 1.34 亿美元
ChipAgents 宣布追加 6000 万美元 A2 轮融资，使 A 轮总额扩大到 1.34 亿美元，距其首次 A 轮关闭仅六个月，新投资方 B Capital 加入，Bessemer、Micron、MediaTek、Ericsson 等现有投资方继续参与。
推荐理由：ChipAgents 在首轮 A 轮关闭六个月后追加 6000 万美元，原文给出 ARR 增长与部署公司数量，可用于观察智能体 AI 在芯片设计验证中的商业进展。
ChipNexus 官方动态精选AI 评分6565 ChipNexus 发布 NEX v5.55，新增自定义技能与 EDA 环境解析
ChipNexus 发布 NEX v5.55，新增自定义技能、近乎无限的会话和更强的 EDA 环境识别能力。自定义技能遵循开放的 Agent Skills 规范，以 SKILL.md 组织，可附带脚本与模板；会话通过把较早的对话压缩成模型撰写的摘要来延续，完整对话保存在无损归档中。
推荐理由：原文列出 NEX v5.55 的自定义技能、上下文压缩与 EDA 环境解析能力，可用于评估智能体接入现有工具链的条件。